CPLD Sumador de 4 bits UPB Parte 1/2

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Uploaded by on Mar 10, 2010

Diseño de un sumador de 4 Bits usando Xilinx ISE Webpack 11.1 (4 bits adder)
Laboratorio de Técnicas Digitales
Grupo de Microelectrónica
Universidad Pontificia Bolivariana
Profesor: Fabio Andrés Guzmán Figueroa

Category:

Education

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  • Hola, gracias por la aportación, estoy comenzando con una spartan-3 que compré muy barata a una persona que ya no la ocupaba (mas o menos 65 dolares), tu video esta muy completo, voy a termianr de verlo y lo voy a implementar, saludos desde México.

  • Yo lo implemente en MAX-Plus II y todo perfecto bien por el video.

    Bueno ademas le agrege un restador que no fue nada dificil.

    Gracias me ayudo mucho tu video.

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